借助于DSP Builder中的Signal Complier模块，可以容易地将设计完成的系统直接转化成RTL级的硬件描述语言，在QuartusⅡ下完成VGA时序的验证与正弦波信号的下载与显示。
从显示器上硬件仿真结果来看，正弦波的幅度在有效的显示区域内呈周期性变化，因此当显示器与VGA口的J21相连时，屏幕上正弦波幅度在设计的范围内显示，一幅屏幕所显示的周期数和DSP Builder中所设定的一致。在此基础上还可以调整正弦波的采样频率，控制正弦波的显示频率与幅度大小，实现示波器的功能，观察FPGA内部的信号。
结语
随着VGA接口的广泛使用，这种结合FPGA与DSP Builder的系统级设计方法已经展现优势。从整个设计流程来看，系统的灵活性强，可靠性高，设计周期大大缩减，成本降低，且系统的可扩展性强。未来，VGA接口的图像与视频监控系统应用将会很有市场。
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