那么这就产生了这样的问题，如果在不同时钟速率情况下性能差别不大，为什么我们不一直使用最高速率、获得更快的数据转换结果呢？一个原因是，随着时钟速率增加，CMOS电路的功耗会急剧上升。
如果功耗不成问题的话，就可在较快输出速率时求采样数量的平均值，从而进一步提高性能水平。这在带有 32 位累加器的 MSC1210 中很容易实现，它可在无需处理器干预下设置求 256 个采样的平均值。
输入阻抗与斩波稳定性
可把 ΔΣ 转换器的模拟输入看作一个开关和电容器。切换频率的等效结果是一个电阻器连续连接到内部电容器，因此，转换器的输入阻抗直接与切换频率相关。对于MSC1210 来说，输入阻抗如下：（公式略）
如果采样率为15.625 kHz，PGA 为 1，那么，输入阻抗为 5MW。更高的采样率和PGA值会降低该值，为了消除这种影响，许多 ΔΣ 转换器提供一个片上缓冲器。即使采用缓冲器，仍然存在某些阻碍提供高直流精度的输入信号采样。
可编程增益放大器 （PGA）
许多 ΔΣ 转换器提供片上 PGA，但是，它们并不提供相同或预期的效果。某些高增益结果上只是数字数据的漂移，或者乘以 2，基本上没有什么益处。通过仔细检查数据表即可看出这些事实。如果通过因数 2 提高 PGA 同样可降低 ENOB，就没有实际的净增益，而且只意味着噪声涵盖更多的输出电平。
某些时候可采用较小的参考电压提高增益，因为参考电压决定 FS 信号范围。把参考电压降低 50％ 可使输入信号增益为 2，但是，这种增益提高会导致低参考电压的噪声限制。
建立时间
建立时间是多通道系统中影响数据吞吐率的另一个因素。为了实现高性能，ΔΣ 转换器通常采用 FIR 滤波器，如：sinc3 滤波器。其优势是在整个滤波器中信号延迟均是固定的，而且也易于进行调整，以便采用更多延迟采样阶段来实现可变的抽样水平。在更多滤波阶段情况下，输出数据速率较低，一个 sinc3 滤波器需要三个转换周期以完全达到预期的精确度。
建立时间会导致通道切换后的前几个采样存在建立误差，这个问题已经在 MSC1210 中得到解决，方法是采用三种滤波器以及可在通道切换后选择最佳滤波器的自动模式。对于改变多路复用器后的前两个采样，采用最快的建立滤波器，然后采用 sinc2 滤波器，最终采样全部采用 sinc3 滤波器。这样就可以完全建立所有转换结果。
对于多路复用数据系统来说，解决建立时间问题的一个方法是采用快得多的数据速率并求输出的平均值。例如，假设希望采用 60Hz 的数据输出率来获得 60Hz 的衰减滤波的优势，可采用 240Hz 的采样率并平均 4 个采样值来获得最终 60Hz 的数据速率，其优势是，当前滤波器建立时间已经从 60Hz 时的 4 个采样（非同步通道切换）（66.6ms） 降低到 240Hz时的 4 个采样 （16.6ms）。建立时间现在是一个 60Hz 数据速率的采样周期，同时可保留60Hz 衰减滤波器的优势。在 MSC1210 中，设置了一个 32 位累加器来求 4 个采样的平均值，抛弃通道切换后的第一个结果（假设通道切换与 60Hz 输出速率同步）。