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vhdl语言的操作符
VHDL提供了多种预定义的运算操作符：
1.赋值运来算符：赋值运算符用来给信号、变量和常数赋值。
2.逻辑操作符：逻辑运算的操作数必须是BIT，STD_LOGIC或STD_ULOGIC类型源的数据（或者是这些数据类型的扩展，即BIT_VECTOR，STD_LOGIC_VECTOR或STD_ULOGIC_VECTOR）。
3.算术操作符：用来执行算知术运算操作。操作数可以是INTEGER，SIGNED，UNSIGNED或REAL数据类型，其中REAL类型是不可综合的。如果声明了ieee库中的包集std_logic_signed和std_logic_unsigned，即可对STD_LOGIC_VECTOR类型的数据进行加法和减法运算。
4.关系操作符： 操作数必须是BIT， BIT_VECTOR， INTEGER。
5.并置操作符 ： 并置运算符用于位和位矢量道的拼接，其操作数可以是支持逻辑运算的任何数据。
vhdl语言有什么用
VHDL（高速集成电路硬件描述语言）是为了给数字电路的描述与模拟提供一个基本的标准。VHDL语言作为高级硬件行为描述型语言，如今已经广泛被应用到FPGA/CPLD和ASIC中的设计。
VHDL是一种用来描述数字逻辑系统的“编程语言”。它通过对硬件行为的直接描述来实现对硬件的物理实现，代表了当今硬件设计的发展方向。VHDL是为了满足逻辑设计过程中的各种需求而设计的。
第一，它是可以用来描述逻辑设计的结构，比如逻辑设计中有多少个子逻辑，而这些子逻辑又是如何连接的。除此之外，VHDL并不十分关心一个具体逻辑依靠何种方式实现，而是把开发者的精力集中到逻辑所实现的功能上。