（4）芯片的电源引脚和地线引脚之间应进行去耦。去耦电容采用0.01uF的片式电容，应贴近芯片安装，使去耦电容的回路面积尽可能减小。
（5）选用贴片式芯片时，尽量选用电源引脚与地引脚靠得较近的芯片，可以进一步减小去耦电容的供电回路面积，有利于实现电磁兼容。
3.3.3信号线的布局
用单层薄膜工艺时，一个简便适用的方法是先布好地线，然后将关键信号，如高速时钟信号或敏感电路靠近它们的地回路布置，最后对其它电路布线。信号线的布置最好根据信号的流向顺序安排，使电路板上的信号走向流畅。
要把EMI减到最小，就让信号线尽量靠近与它构成的回流信号线，使回路面积尽可能小，以免发生辐射干扰。低电平信号通道不能靠近高电平信号通道和无滤波的电源线，对噪声敏感的布线不要与大电流、高速开关线平行。如果可能，把所有关键走线都布置成带状线。不相容的信号线（数字与模拟、高速与低速、大电流与小电流、高电压与低电压等）应相互远离，不要平行走线。信号间的串扰对相邻平行走线的长度和走线间距极其敏感，所以尽量使高速信号线与其它平行信号线间距拉大且平行长度缩小。
的电感与其长度和长度的对数成正比，与其宽度的对数成反比。因此，导带要尽可能短，同一元件的各条地址线或数据线尽可能保持长度一致，作为电路输入输出的导线尽量避免相邻平行，最好在之间加接地线，可有效抑制串扰。低速信号的布线密度可以相对大些，高速信号的布线密度应尽量小。
层厚膜工艺中，除了遵守单层布线的规则外还应注意：
设计单独的地线面，信号层安排与地层相邻。不能使用时，必须在高频或敏感电路的邻近设置一根地线。分布在不同层上的信号线走向应相互垂直，这样可以减少线间的电场和磁场耦合干扰;同一层上的信号线保持一定间距，最好用相应地线回路隔离，减少线间信号串扰。每一条高速信号线要限制在同一层上。信号线不要离基片边缘太近，否则会引起特征阻抗变化，而且容易产生边缘场，增加向外的辐射。
3.3.4时钟线路的布局
电路在数字电路中占有重要地位，同时又是产生电磁辐射的主要来源。一个具有2ns上升沿的时钟信号辐射能量的频谱可达160MHz。因此设计好时钟电路是保证达到整个电路电磁兼容的关键。关于时钟电路的布局，有以下注意事项：
（1）不要采用菊花链结构传送时钟信号，而应采用星型结构，即所有的时钟负载直接与时钟功率驱动器相互连接。
（2）所有连接晶振输入/输出端的导带尽量短，以减少噪声干扰及分布电容对晶振的影响。